全新的“spider”网络内存总线

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如何保证半实物仿真系统节点间的高速实时互连 , 并降低通信延迟 ?如何实现多余度系统从电源到控制器，尤其接口的全面冗余？
7 d; x9 Q' T$ W$ f8 F全新的“spider”网络内存总线皆能做到。
独家创新设计的总线公共存储策略，多达1Ｇ内存； 性能优异的2.5Ｇ光纤链路；极低的200ns延迟 ；尤其可靠的冗余IP核。各项先进科技，将总线控制提升到一全新高度。
% K) ~8 ^# k# p# o9 u7 B2 o# b) `1 K“spider”，从未体验的网络内存总线。
3 I: u/ q" i. f2 _0 ~8 H. M“spider”网络内存总线是用于需要较高实时性要求应用领域的专用网络通讯技术，采用创新设计的总线公共存储策略，它除了具有严格的传输确定性和可预测性外，还具有速度高、通信协议简单、宿主机负载轻、软硬件平台适应性强、可靠的传输纠错能力、支持中断信号的传输等特点，尤其是可靠的冗余IP核设计。

技术特点：
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尤其可靠的冗余IP核设计，实现多余度系统从电源到控制器，尤其接口的全面冗余;
0 C1 M6 k& Y! c4 b6 X- yl
: p/ x: _1 m. [. K0 o" C传输速率优势明显；
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: `. A' \+ [5 ^' `" ~: j4 l1 w网络传输延迟小，适合于多节点大量数据的实时传输；
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$ y  A' i! j$ ]: D9 T+ R  R节点数可达128个；
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完全国内自主研发，自主产权 ，如果所建立的系统需要
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! X' |: H) _. [5 G0 S8 h扩展，能够得到有效的保证；
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% K$ j* o& Q( j% J& V系统集成简单，系统扩展空间大。
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' l( ^1 X) G- b# L  u9 `: x5 ~4 V单余度系统总体设计方案：
$ L! ^; G( K! p. |& C系统的总体需求是构建一个32节点互联的系统，因此
8 e+ _4 c4 L5 M+ O9 S8 G% b5 G我们采用星型的网络结构模式 ，这样的优点为，通过Spider
9 ]# d0 \/ r1 F9 Z) u/ E$ E# m2 p总线集线器的自动旁路功能，网络上任何节点的断开（节点计
算机不启动）不会影响其它节点和整个实时网络的正常运行，
* S" W+ U; b7 _0 \这样便于系统的调试，更有利于提高系统的运行可靠性和简易
- {0 D1 T! [4 J9 ]5 f性。
“spider” 网络内存总线的组成
$ C# v9 H& U8 k5 Q% M基于星型的网络结构模式 ，“spider”网络内存总线的组
成如下：
• 32块 spider内存节点卡（插在节点的 PCI或VME或 PMC
3 |7 q% O5 {: S   插槽上，即可将系统连接到实时网络上）；
  j; {4 b: a  ]0 Q  F • 5块spider总线集线器（独立工作 ，通过光纤将32个节
   点连接到集线器 ，集线器之间也是通过光纤构成环形结构
   连接）；
6 ?! H3 v$ k& j0 A4 B$ m! F • 69根反射内存专用光纤（其中5根用于将5个8端口集线
   器连接 ，64根光纤将32个节点连接到集线器上）。
4 ^$ T) P. L7 f$ _5 m" L9 j8 D采用spider的优点　
, k) G+ z. `+ F3 R5 w% M" V+ f" S • 系统可扩充性强，可无缝升级到多余度模式；
• 高速的、基于2.5G波特率的总线；
1 k1 b( q6 K  E; e( [6 f • 简单易用；
/ `4 }! v+ l) ^! r9 Q7 e2 R, J • 与操作系统和处理器无关； 　
0 J+ b) L4 {0 Y* T+ ]0 w • 彻底省去软件开发开销和周期；
• 可以实现实时连接的稳定的数据传输；
0 x0 Z+ s! a8 i • 可以与通用的计算机和总线连接；
• 比标准通信和技术更为优越；
• 极短的数据传输延迟；
• 简单的软件、较低的管理费用和较高的抗干扰能力；
5 r3 M& k% {. _- N • 节点间距离可达10公里（单模）。

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对这个不是非常清楚，不过初步了解了一下，感觉非常好，也很实用，谢谢楼主介绍！